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利用 CPLD 降低處理器功耗
利用 CPLD 降低處理器功耗
 更新時間:2008-8-3 15:44:39  點擊數(shù):30
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e: 宋體; mso-bidi-font-family: ZH-CN?>處理器的空閑模式節(jié)電效果顯著,但仍保持對 LCD、存儲器和 I/O 控制器等模塊供電。即使對 CPU 的時鐘輸入已經停止,外設模塊仍處于活動狀態(tài)?臻e模式仍會消耗 100mW 左右的可觀功率。處理器進入睡眠模式后,僅為活動模塊供電,使其響應中斷和喚醒信號請求。睡眠模式比空閑模式功耗更小,其所耗電流可低于 100mA。 

 

插入響應和處理系統(tǒng)中斷的外部器件可以減少處理器的操作任務。通過讓微處理器保持盡可能長的斷電模式,即可顯著降低功耗。 

 

    必須發(fā)生某一事件才能使微處理器從斷電模式返回到正常操作模式。以下事件可喚醒處理器但因制造商、器件和當前操作模式而異 

 

    硬件復位 

    系統(tǒng)中斷 

   

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